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[求助] cedence奇怪的现象

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发表于 2010-4-28 16:15:24 | 显示全部楼层 |阅读模式

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[img]file:///F:\DOCUME~1\ADMINI~1\LOCALS~1\Temp\WDJ1B}Y1T7D]Y{R[HU0ZHIT.jpg[/img]我在这张图最左下角的port明明输入的时候是-20dBm,可是到最后仿真结束,我想看转换增益的时候,pss仿真过后,当我测power的时候,它居然显示为-14dBm了,不知道这是怎么回事,有人知道吗?
WDJ1B}Y1T7D]Y{R[HU0ZHIT.jpg
 楼主| 发表于 2010-4-28 16:21:48 | 显示全部楼层
由于我采用的是基带输入源端直接接地的(没有电流源),所以在工艺角仿真的时候,由于vth会来回变化60mV,所以我的电流变化的很大,也导致我的指标相差太大
工艺角             电流             转换增益            1dB压缩点  
ss                 2.34mA         -10dB                  >0....dBm(个人觉得这个太不正常了)
tt                  4.8mA           -6dB                   -4.9dBm  
ff                   7.8mA(电流太大了)-4.7dB      -5.7dBm
有人知道该怎么处理吗?除了让我加电流源以外还有什么办法???
你们知道我的问题出现在哪里吗。。。。
发表于 2010-4-28 16:46:38 | 显示全部楼层


file:///F:\DOCUME~1\ADMINI~1\LOCALS~1\Temp\WDJ1B}Y1T7D]Y{R[HU0ZHIT.jpg我在这张图最左下角的port明明输入的时候是-20dBm,可是到最后仿真结束,我想看转换增益的时候,pss仿真过后,当我测power的时候,它居然显 ...
lucia720 发表于 2010-4-28 16:15



这个正常,想想为什么差的是6dB,而不是别的值?再想想阻抗匹配,相信你会得到答案的。
 楼主| 发表于 2010-4-28 21:16:48 | 显示全部楼层
3# vvsilicon
我的输入port=50欧,是不是因为和实际输入阻抗不同所以造成的结果?我还想知道的是这对我进行增益比较时没有影响的对吗?
 楼主| 发表于 2010-4-28 23:28:09 | 显示全部楼层
up!up!
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